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Speichelatenzen werden in Taktzyklen angegeben. Ein Speicher mit CL2 und FSB 200 MHz würde theoretisch (ist natürlich total unsinnig) 100000000/s auf den Befehl "Read" die angeforderten Daten senden.
(CL steht für CAS-Latency, auf Deutsch Latenz-Zeit, die vergeht zwischen dem Lesekommando Read und der Datenausgabe aus dem Speicherbaustein.)