Sun stellt Multicore-CPU "UltraSPARC T1" vor [UPDATE]

gruenmuckel

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Sun stellt heute den unter dem Codenamen "Niagara" entwickelten Multi-Core Prozessor UltraSPARC T1 vor. Erstmals hat nun auch Sun einen eigenen Prozessor mit mehr als zwei Kernen im Angebot. Dieser soll in Entry-Level Servern eingesetzt werden und damit dem Xeon von Konkurrent Intel Konkurrenz machen.

Der UltraSPARC T1 taktet etweder mit 1,0 ghz oder 1,2 ghz und hat 4, 6 oder 8 Kerne, welche wiederum jeweils 4 Threads parallel bearbeiten können. Das Topmodell kann also 32 Berechnungen parallel ausführen und verbraucht dabei nur typisch 72 Watt und maximal 79 Watt.
Sun verspricht sich großen Erfolg, geht die Firma damit die doch teilweise argen Kühlungsprobleme an, mit denen einige Rechenzentren zu kämpfen haben.

<b>Spezifikationen:</b>

<b>CPU</b>
<ul><li>SPARC V9 Architecture</li><li>On-chip level 2 cache</li><li>Public key encryption support (RSA)</li><li>48-bit virtual, 40-bit physical address space</li><li>Support for four page sizes: 8K, 64K, 4M, 256M</li><li>Support for Hypervisor</li><li>4, 6, or 8 core versions</li></ul><b>Cache</b>
<ul><li>16 KB primary instruction cache per core</li><ul><li>Parity protected and single-bit error recoverable</li><li>4-way set-associative</li></ul></ul><ul><li>8 KB primary data cache per core</li><ul><li>Parity protected and single-bit error recoverable</li><li>4-way set-associative</li></ul></ul><ul><li>3 MB unifed level 2 cache</li><ul><li>12-way set associative, 4 banks</li><li>ECC</li></ul></ul><b>Memory</b>
<ul><li>Up to 8 cores, 4 threads per core</li><li>4 144-bit DDR2-533 SDRAM interfaces</li><ul><li>Quad error correct, octal error detect, chipkill ECC</li></ul><li>4 DIMMS per controller - 16 DIMMS total</li><li>Optional 2-channel operation mode</li><li>JBUS Interface</li><ul><li>3.1 GB/sec peak effective bandwidth</li><li>128 bit address/data bus</li><li>50 - 200 MHz operation</li></ul></ul>
<b>Links zum Thema:</b>
<ul><li><a href="http://www.sun.com/processors/UltraSPARC-T1/specs.xml" target="b">UltraSPARC T1 specifications</a> <img src="/images/englisch.gif" border="1" height="10" width="15"></li><li><a href="http://www.sun.com/smi/Press/sunflash/2005-11/sunflash.20051114.2.html" target="b">Pressemitteilung Sun Microsystems zum Launch</a> <img src="/images/englisch.gif" border="1" height="10" width="15"></li><li><a href="http://de.sun.com/company/press-releases/2005/pm_087.html" target="b">Pressemitteilung Sun Microsystems zum Launch</a> <img src="/images/deutsch.gif" border="1" height="10" width="15"></li></ul><b>Deutsche Pressemitteilung hinzugefügt.</b>

<a href="http://www.planet3dnow.de/vbulletin/showthread.php?p=2476575">-> Kommentare</a>
 
D&#252;rften im Kern wohl relativ &#228;hnlich zu den UltraSPARC IV+ sein, blo&#223; eben st&#228;rker auf Parallelisierung ausgelegt. Der einzelne Thread wird wegen des etwas niedrigeren Taktes wahrscheinlich auch langsamer abgearbeitet, aber Sun hat ja die "Vision des Throughput Computing" oder "wichtig ist, was hinten rauskommt" ;) was ja gerade im Serverbereich Sinn macht und mit dieser neuen Architektur sind sie wohl wieder deutlich besser aufgestellt als bisher.

Oder vermute ich falsch, und die Cores selbst sind auch total anders?

Edit: Hmm, hier steht was von sechsstufigen Pipelines und hier was von 14-stufigen, kann also gut sein, da&#223; es doch komplett unterschiedliche Cores sind und nicht einfach aneinandergeklebte UltraSPARC IV+.
 
Zuletzt bearbeitet:
Der Core k&#246;nnte auch ein SPARC III sein ... bin mir allerdings auch nicht sicher, soll auch pinkompatibel mit was &#228;lterem von Sun sein.
 
soweit ich mich erinnern kann, basiert der T1 auf dem kleinen SPARC II. nur halt 8 stück davon...
 
genau, der wars...
 
Uuups noch kleiner, hat da jemand einen Link dazu?

Stand direkt bei Sun zum Rock nicht drin, jedenfalls nicht augenfällig (nur die Bandbreite war doch ein wenig dünne).
 
stand glaub ich mal irgendwann im prozessorgeflüster in der C'T...

so, hier isses: link
 
4 144-bit DDR2-533 SDRAM interfaces
Hat jemand einen Hinweis dazu, wieviele Pins/Balls/... der Sockel hat? Und was hat der Chip sonst noch als IO, ist das der JBUS?
 
also so wie das auf dem bild aussieht, sind das auf jeden fall mehr aus 1000. kannst ja mal zählen

I1_t1_lg.jpg
 
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