Kommende AMD 760MPX Revision DDR333 tauglich?

Nero24

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Bei den Kollegen von <a href="http://forums.2cpu.com/showthread.php?threadid=17910" TARGET="_blank">2CPU.com</a> brodelt momentan die Gerüchteküche was die kommenden Steppings/Revisionen des Dual-Chipsatzes AMD 760MPX betrifft. Zum einen soll Ende Mai endlich das neue Stepping des Chipsatzes mit gefixtem USB-Controller flächendeckend verfügbar sein. Bei den momentan ausgelieferten Chips befindet sich ein Bug im USB-Controller, weshalb die meisten Mainboard-Hersteller den Onboard-Controller komplett deaktiviert haben und eine separate USB PCI-Karte beilegen.

Desweiteren sollen Informationen vorliegen, wonach schon bald darauf eine dritte Revision des Chipsatzes verfügbar sein soll, die einen USB 2.0 Controller integriert und und DDR333 unterstützen soll. Letzteres sollte Dual-Systeme auf jeden Fall stärker beflügeln, als die Single-Plattformen. Da die beiden CPUs Punkt-zu-Punkt mit der Northbridge verbunden sind, müssen sich 2x FSB266 (equivalente Bandbreite zu FSB533) momentan einen DDR266-Speicherkanal teilen. Hier sollte DDR333 schon meßbare Vorteile bringen. Doch momentan handelt es sich dabei ausschließlich um wage Gerüchte...
THX @Jochen für den Hinweis :-)
 
Nero, muss dich leider berichtigen, der USB-Bug ist schon gefixt.
Steht in der aktuellen errata.

Jedi
 
Hmm, also berichtige mich bitte, sollte ich falsch liegen...
http://www.amd.com/us-en/assets/content_type/white_papers_and_tech_docs/24472.pdf

Dort steht eigentlich nur, daß der Bug mit "B1" auftritt, mit "B2" nicht mehr. Das war klar. Aber dort steht nicht, daß das "B2" Stepping bereits flächendeckend verfügbar ist. Ferner liefert z.B. Asus noch immer die separate USB-Karte mit. Womöglich erst Lager abbauen, ehe AMD die neue Bridge herausrückt? :]

Modified: Ok ;)
 
PC333 wäre echt löblich, da die beiden separaten FSBs des MPX an Bedeutung gewinnen. Sinnvoller wäre natürlich ein Dual Channel Memory Controller, was natürlich teurer und komplizierter zu realisieren ist.
Das wäre übrigens AMDs erster asynchron laufender Chipset.
 
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