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Mehr zum Thema Z-RAM
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Anfang dieses Jahres hatte AMD die Z-RAM-Technik von Innovative Silicon Inc. lizenziert (wir <a href="http://www.planet3dnow.de/cgi-bin/newspub/viewnews.cgi?category=1&id=1137942646">berichteten</a>). Bereits damals blühten die Spekulationen, inwiefern AMD diese Technik in zukünftigen Prozessoren einsetzen könnte.
In zwei Interviews wurden nun Angehörige von Innovative Silicon Inc. zum Thema Z-RAM-Technik befragt:<ul><li><a href="http://www.lostcircuits.com/memory/zram/" target="b"> Z-RAM, A Breakthrough in Memory Technology? (LostCircuits)</a></li>
<li><a href="http://www.digitimes.com/bits_chips/a20060328PR202.html" target="b">The case for Z-RAM: Q&A with memory specialist Innovative Silicon (DigiTimes)</a></li></ul>
In zwei Interviews wurden nun Angehörige von Innovative Silicon Inc. zum Thema Z-RAM-Technik befragt:<ul><li><a href="http://www.lostcircuits.com/memory/zram/" target="b"> Z-RAM, A Breakthrough in Memory Technology? (LostCircuits)</a></li>
<li><a href="http://www.digitimes.com/bits_chips/a20060328PR202.html" target="b">The case for Z-RAM: Q&A with memory specialist Innovative Silicon (DigiTimes)</a></li></ul>
thunderbuster
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Kann der ganzen Geschichte nicht ganz folgen..welchen Benefit hat AMD von dieser Technik? Haben wir in kürze ein komplett neue Speichergeneration zu erwarten?
Kein DDR3?
Kein DDR3?
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Kann der ganzen Geschichte nicht ganz folgen..welchen Benefit hat AMD von dieser Technik? Haben wir in kürze ein komplett neue Speichergeneration zu erwarten?
Kein DDR3?
Nein das Ganze ist eine Alternative zu SRAM Cache.
Den Vorteilen von groesserer Dichte (also weniger Flaeche, die bei der Herstellung hoehere Kosten bedeutet) stehen allerdings höhrere Latenzen gegenueber.
Herby
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Dafür könnte bei Mehrkernprozessoren jeder Kern einen eigenen Cache bekommen.
Hat nicht AMD verlauten lassen, dass ihre Prozessoren eh nicht soviel von mehr Cache profitieren würden? Aber wenn jeder Kern seinen eigenen bekommt, wäre das sicher ein großer Schub.
Und ich dächte, dass man das mit den Latenzen noch in den Griff bekommen müsste, da sonst bei Single Prozzies gar kein Vorteil wäre, oder? Und warum hat Intel eigentlich nicht seine Finger im Spiel, die müssten doch mit ihrem L1, L2 & L3 da noch mehr Vorzüge erhalten. Dort ist Cache ja noch der große Trumpf.
PS:
Edit: Hier noch 2 Links zu dem Thema: Link Eins & Link Zwei.
Hat nicht AMD verlauten lassen, dass ihre Prozessoren eh nicht soviel von mehr Cache profitieren würden? Aber wenn jeder Kern seinen eigenen bekommt, wäre das sicher ein großer Schub.
Und ich dächte, dass man das mit den Latenzen noch in den Griff bekommen müsste, da sonst bei Single Prozzies gar kein Vorteil wäre, oder? Und warum hat Intel eigentlich nicht seine Finger im Spiel, die müssten doch mit ihrem L1, L2 & L3 da noch mehr Vorzüge erhalten. Dort ist Cache ja noch der große Trumpf.
PS:
Mach mal das "t" weg.In zweit Interviews
Edit: Hier noch 2 Links zu dem Thema: Link Eins & Link Zwei.
Zuletzt bearbeitet:
Hans Fuchs
Commander
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@pipn
Ich dachte die latenzen sind genau so hoch wie bei SRAM? Wen wir vom L2 ausgehen.
Schick mal bitte ein link zum Thema.
@Herby
Z-RAM ist ein SOI technick und die hatt Intel nicht.
Ich dachte die latenzen sind genau so hoch wie bei SRAM? Wen wir vom L2 ausgehen.
Schick mal bitte ein link zum Thema.
@Herby
Z-RAM ist ein SOI technick und die hatt Intel nicht.
Die Latenzen sind höher, aber Z-RAM soll wohl deutlich weniger Fläche schlucken... stand doch in den letzten News .
Für Single- und Dualcores mit Dualchannel Anbindung macht das wahrscheinlich noch nich so sehr viel Sinn, aber spätestens bei Quad Cores, wo die Speicherbandbreite pro CPU immer kleiner wird, könnte das durchaus was bringen. Der L2 vom K8 ist sowieso nicht der schnellste, vielleicht ließe sich der sogar durch Z-RAM ersetzen (aber wohl nicht mit 3ns Latenz).
Würde vielleicht 40Mio Transistoren einsparen, was ja auch net zu verachten ist.
Für Single- und Dualcores mit Dualchannel Anbindung macht das wahrscheinlich noch nich so sehr viel Sinn, aber spätestens bei Quad Cores, wo die Speicherbandbreite pro CPU immer kleiner wird, könnte das durchaus was bringen. Der L2 vom K8 ist sowieso nicht der schnellste, vielleicht ließe sich der sogar durch Z-RAM ersetzen (aber wohl nicht mit 3ns Latenz).
Würde vielleicht 40Mio Transistoren einsparen, was ja auch net zu verachten ist.
Dragoran
Captain Special
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das ist jetzt schon so (zumindest bei amd)Dafür könnte bei Mehrkernprozessoren jeder Kern einen eigenen Cache bekommen.
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Die Latenzen sind höher, aber Z-RAM soll wohl deutlich weniger Fläche schlucken... stand doch in den letzten News .
Für Single- und Dualcores mit Dualchannel Anbindung macht das wahrscheinlich noch nich so sehr viel Sinn, aber spätestens bei Quad Cores, wo die Speicherbandbreite pro CPU immer kleiner wird, könnte das durchaus was bringen. Der L2 vom K8 ist sowieso nicht der schnellste, vielleicht ließe sich der sogar durch Z-RAM ersetzen (aber wohl nicht mit 3ns Latenz).
Würde vielleicht 40Mio Transistoren einsparen, was ja auch net zu verachten ist.
Das Schlimme am L2 Cache des K8 ist, dass er total miese Dichte im Vergleich zu den Intelprozessoren hat.
Intel hat deshalb und dank seiner 5.000 Fabs (grobe Schaetzung ) ueberhaupt keine Prolbeme mal eben mehr Cache in seine Prozessoren zu packen.
Wuerde AMD das versuchen, haetten sie ein riesiges Kapazitaetsproblem.
HANNI3AL
Redshirt
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@pipin
Wie meinst du das mit "Das Schlimme am L2 Cache des K8 ist, dass er total miese Dichte"??
Wie meinst du das mit "Das Schlimme am L2 Cache des K8 ist, dass er total miese Dichte"??
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@pipin
Wie meinst du das mit "Das Schlimme am L2 Cache des K8 ist, dass er total miese Dichte"??
AMD kann den Cache nicht so dicht "packen" wie zum Beispiel Intel oder IBM. Ergo verbraucht der eine groessere Flaeche. Dadurch werden die Dies groesser, dadurch passen weniger Dies auf einen Wafer. usw. usw.
Ergo suboptimal.
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AMD hat einfach noch nicht den richtigen Dreh raus, die Cachezellen sehr kompakt in Silizium zu gießen.
Eben reines Fertigungs- und kein Designproblem.
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